Merge branch 'for-3.0' into for-3.1
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@@ -1713,6 +1713,8 @@ static int _wm8994_set_fll(struct snd_soc_codec *codec, int id, int src,
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snd_soc_update_bits(codec, WM8994_FLL1_CONTROL_1 + reg_offset,
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snd_soc_update_bits(codec, WM8994_FLL1_CONTROL_1 + reg_offset,
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WM8994_FLL1_ENA | WM8994_FLL1_FRAC,
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WM8994_FLL1_ENA | WM8994_FLL1_FRAC,
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reg);
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reg);
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msleep(5);
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}
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}
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wm8994->fll[id].in = freq_in;
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wm8994->fll[id].in = freq_in;
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@@ -222,12 +222,18 @@ static int tegra_i2s_hw_params(struct snd_pcm_substream *substream,
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if (i2sclock % (2 * srate))
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if (i2sclock % (2 * srate))
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reg |= TEGRA_I2S_TIMING_NON_SYM_ENABLE;
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reg |= TEGRA_I2S_TIMING_NON_SYM_ENABLE;
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if (!i2s->clk_refs)
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clk_enable(i2s->clk_i2s);
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tegra_i2s_write(i2s, TEGRA_I2S_TIMING, reg);
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tegra_i2s_write(i2s, TEGRA_I2S_TIMING, reg);
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tegra_i2s_write(i2s, TEGRA_I2S_FIFO_SCR,
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tegra_i2s_write(i2s, TEGRA_I2S_FIFO_SCR,
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TEGRA_I2S_FIFO_SCR_FIFO2_ATN_LVL_FOUR_SLOTS |
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TEGRA_I2S_FIFO_SCR_FIFO2_ATN_LVL_FOUR_SLOTS |
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TEGRA_I2S_FIFO_SCR_FIFO1_ATN_LVL_FOUR_SLOTS);
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TEGRA_I2S_FIFO_SCR_FIFO1_ATN_LVL_FOUR_SLOTS);
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if (!i2s->clk_refs)
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clk_disable(i2s->clk_i2s);
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return 0;
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return 0;
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}
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}
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